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想拿高薪offer吗?这些常见硬件工程师面试题你必须懂!

发布时间:2019-05-25 08:17 来源:未知 编辑:admin

  鉴于我们的粉丝用户32%都是学生群体,开始前想先跟大家谈下小编的个人经历,某知名211(电子)高校电子相关专业毕业,去年秋招时跟某上市电子公司签了offer(技术岗位),工作九个月后,因为个人兴趣转身投于运营岗位。所以我希望大家在准备找工作前,先给自己定位,充分了解你所想从事的行业(需要哪些知识技能储备?

  不过,一般关注了“电子发烧友网”并点进来阅读的,都是立志从事于电子行业并渴望在这个行业实现自我价值的勇士。

  在求职过程中,尤其是技术岗位(电子工程师),我们每个人前期都会做的准备工作:上网查笔试、面试题(大佬请无视)。小编精心汇集整理了常见的硬件工程师笔试、面试题,希望能帮助到大家!

  4、请谈谈对一个系统设计的总体思路。针对这个思路,你觉得应该具备哪些方面的知识?

  5、描述过去一年中您参与的最具挑战性的工程项目,你觉得项目的挑战点是什么?

  关于基础篇(主观题),欢迎大家踊跃投稿,小编会选出几篇优秀的回答跟大家一起在后几期中一起分享!另外关于技术知识问答,也欢迎行业内的大佬投稿提出宝贵的修改完善意见,让小白们吸收到更优质的知识内容,一起进步!

  答:Setup/Hold Time 用于测试芯片对输入信号和时钟信号之间的时间要求。建立时间(Setup Time)是指触发器的时钟信号上升沿到来以前,数据能够保持稳定不变的时间。

  输入数据信号应提前时钟上升沿(如上升沿有效)T 时间到达芯片,这个T就是建立时间通常所说的SetupTime。如不满足Setup Time,这个数据就不能被这一时钟打入触发器,只有在下一个时钟上升沿到来时,数据才能被打入触发器。保持时间(Hold Time)是指触发器的时钟信号上升沿到来以后,数据保持稳定不变的时间。如果Hold Time不够,数据同样不能被打入触发器。

  答:在组合逻辑电路中,由于门电路的输入信号经过的通路不尽相同,所产生的延时也就会不同,从而导致到达该门的时间不一致,我们把这种现象叫做竞争。由于竞争而在电路输出端可能产生尖峰脉冲或毛刺的现象叫冒险。如果布尔式中有相反的信号则可能产生竞争和冒险现象。解决方法:一是添加布尔式的消去项,二是在芯片外部加电容。

  答:线与逻辑是两个或多个输出信号相连可以实现与的功能。在硬件上,要用 OC 门来实现(漏极或者集电极开路),为了防止因灌电流过大而烧坏 OC 门,应在 OC 门输出端接一上拉电阻(线或则是下拉电阻)。

  答:同步逻辑是时钟之间有固定的因果关系。异步逻辑是各时钟之间没有固定的因果关系.电路设计可分类为同步电路设计和异步电路设计。同步电路利用时钟脉冲使其子系统同步运作,而异步电路不使用时钟脉冲做同步,其子系统是使用特殊的 “开始”和“完成”信号使之同步。异步电路具有下列优点:无时钟歪斜问题、 低电源消耗、平均效能而非最差效能、模块性、可组合和可复用性。

  (6) 你知道那些常用逻辑电平?TTL 与 COMS 电平可以直接互连吗?

  一般说来,CMOS 电平比 TTL 电平有着更高的噪声容限。如果不考虑速度 和性能,一般 TTL 与 CMOS 器件可以互换。但是需要注意有时候负载效应可能引起电路工作不正常,因为有些 TTL 电路需要下一级的输入阻抗作为负载才能 正常工作。

  (7) 请画出微机接口电路中,典型的输入设备与微机接口逻辑示意图(数据接口、控制接口、锁存器/缓冲器)

  答:ROM(只读存储器)、PLA(可编程逻辑阵列)、FPLA(现场可编程逻辑阵列)、PAL(可编程阵列逻辑)GAL(通用阵列逻辑),EPLD(可擦除的可编程逻辑器件)、 FPGA(现场可编程门阵列)、CPLD(复杂可编程逻辑器件)等 ,其中 ROM、FPLA、 PAL、GAL、EPLD 是出现较早的可编程逻辑器件,而 FPGA 和 CPLD 是当今最流行的两类可编程逻辑器件。FPGA 是基于查找表结构的,而 CPLD 是基于乘积项结构的。

  (2)请简述用 EDA 软件(如 PROTEL)进行设计(包括原理图和PCB图)到调试出样机的整个过程,在各环节应注意哪些问题?

  注意适当加入 0 欧电阻、电感和磁珠(专用于抑制信号线、电源线上的高频噪声和尖峰干扰)以实现抗干扰和阻抗匹配;

  KCL:电路中的任意节点,任意时刻流入该节点的电流等于流出该节点的电流(KVL同理)。

  反馈是将放大器输出信号(电压或电流)的一部分或全部,回收到放大器输入端与输入信号进行比较(相加或相减),并用比较所得的有效输入信号去控制输出,负反馈可以用来稳定输出信号或者增益,也可以扩展通频带,特别适合于自动控制系统。正反馈可以形成振荡,适合振荡电路和波形发生电路。

  降低放大器的增益灵敏度,改变输入电阻和输出电阻,改善放大器的线性和非线性失真,有效地扩展,放大器的通频带,自动调节作用

  不同的电路或者说不同的元器件对不同频率的放大倍数是不相同的,如果输入信号不是单一频率,就会造成高频放大的倍数大,低频放大的倍数小,结果输出的波形就产生了失真

  放大电路中频率补偿的目的:一是改善放大电路的高频特性,二是克服由于引入负反馈而可能出现自激振荡现象,使放大器能够稳定工作。

  在放大电路中,由于晶体管结电容的存在常常会使放大电路频率响应的高频段不理想,为了解决这一问题,常用的方法就是在电路中引入负反馈。然后,负反馈的引入又引入了新的问题,那就是负反馈电路会出现自激振荡现象,所以为了使放大电路能够正常稳定工作,必须对放大电路进行频率补偿。

  频率补偿的方法可以分为超前补偿和滞后补偿,主要是通过接入一些阻容元件来改变放大电路的开环增益在高频段的相频特性,目前使用最多的就是锁相环

  有源滤波器:集成运放和 R、C 组成,具有不用电感、体积小、重量轻等优点。 集成运放的开环电压增益和输入阻抗均很高,输出电阻小,构成有源滤波电路后还具有一定的电压放大和缓冲作用。但集成运放带宽有限,所以目前的有源滤波电路的工作频率难以做得很高。

  SSRAM:Synchronous Static Random Access Memory 同步静态随机访问存储器,它的一种类型的SRAM。 SSRAM 的所有访问都在时钟的上升/下降沿启动。地址、数据输入和其它控制信号均与时钟信号相关。

  这一点与异步 SRAM 不同,异步 SRAM 的访问独立于时 钟,数据输入和输出都由地址的变化控制。SDRAM:Synchronous DRAM 同步动态随机存储器。

  2)BIOS:Basic Input Output System的缩略语,直译过来后中文名称就是基本输入输出系统。其实,它是一组固化到计算机内主板上一个 ROM 芯片上的程序,它保存着计算机最重要的基本输入输出的程序、系统设置 信息、开机后自检程序和系统自启动程序。其主要功能是为计算机提供最底层的、 最直接的硬件设置和控制。

  3)USB:Universal Serial BUS(通用串行总线)的缩写,而其中文简称为“通串线,是一个外部总线标准,用于规范电脑与外部设备的连接和通讯。

  4)VHDL:Very High Speed Integrated Circuit的缩写,译成中文就是超高速集成电路硬件描述语言。 主要用于描述数字系统的结构、行为、功能和接口。

  5)SDR:软件无线电,一种无线电广播通信技术,它基于软件定义的无线通信协议而非通过硬连线实现。换言之,频带、空中接口协议和功能可通过软件 下载和更新来升级,而不用完全更换硬件。SDR 针对构建多模式、多频和多功 能无线通信设备的问题提供有效而安全的解决方案。

  首先应该确认电源电压是否正常。用电压表测量接地引脚跟电源引脚之间的电压,看是否是电源电压,例如常用的5V。

  接下来就是检查复位引脚电压 是否正常。分别测量按下复位按钮和放开复位按钮的电压值,看是否正确。

  然后再检查晶振是否起振了,一般用示波器来看晶振引脚的波形,注意应该使用示波器探头的“X10”档。另一个办法是测量复位状态下的IO口电平,按住复位键不放,然后测量IO口(没接外部上拉的P0口除外)的电压,看是否是高电平,如果不是高电平,则多半是因为晶振没有起振。

  另外还要注意的地方是,如果使用片内ROM 的话(大部分情况下如此,现在 已经很少有用外部扩ROM的了),一定要将EA引脚拉高,否则会出现程序乱跑的情况。如果系统不稳定的话,有时是因为电源滤波不好导致的。在单片机的电源引脚跟地引脚之间接上一个0.1uF的电容会有所改善。如果电源没有滤波电容的话, 则需要再接一个更大滤波电容,例如220uF的。遇到系统不稳定时,就可以并上电容试试(越靠近芯片越好)。

  答:三极管的曲线特性即指三极管的伏安特性曲线,包括输入特性曲线和输出特性曲线。输入特性是指三极管输入回路中,加在基极和发射极的电压VBE与由它所产生的基极电流IB之间的关系。输出特性通常是指在一定的基极电流IB控制下,三极管的集电极与发射极之间的电压VCE同集电极电流IC的关系

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  关于我们开设的课程栏目,新人们在大学期间,更多的是学习到模电、数电、编程等方面的基础知识,一旦入手项目时,因为缺乏系统的梳理以及实际运用的经验,导致难度加大,并且最主要的是缺乏与市场这个大环境接轨的机会。

  并且讲师们都是以教初学者的方式去传授知识,入手项目,能让大家更好的完成从“0”→“1”的转变。

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